ISSI SDRAM 128 MB 1M bit SMD 32 bit 6 ns BGA 90-Pin
- RS Best.-Nr.:
- 648-081
- Herst. Teile-Nr.:
- IS42S32400J-6BLI
- Marke:
- ISSI
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Technische Daten
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Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | ISSI | |
| Produkt Typ | SDRAM | |
| Speicher Größe | 128MB | |
| Organisation | 1M bit | |
| Datenbus-Breite | 32bit | |
| Adressbusbreite | 12bit | |
| Taktfrequenz max. | 166MHz | |
| Zugriffszeit max. | 6ns | |
| Montageart | SMD | |
| Gehäusegröße | BGA | |
| Pinanzahl | 90 | |
| Betriebstemperatur min. | -40°C | |
| Maximale Betriebstemperatur | 85°C | |
| Serie | IS42S32400J | |
| Normen/Zulassungen | RoHS | |
| Automobilstandard | Nein | |
| Maximale Versorgungsspannung | 3.6V | |
| Minimale Versorgungsspannung | 3V | |
| Versorgungsstrom | 120mA | |
| Alle auswählen | ||
|---|---|---|
Marke ISSI | ||
Produkt Typ SDRAM | ||
Speicher Größe 128MB | ||
Organisation 1M bit | ||
Datenbus-Breite 32bit | ||
Adressbusbreite 12bit | ||
Taktfrequenz max. 166MHz | ||
Zugriffszeit max. 6ns | ||
Montageart SMD | ||
Gehäusegröße BGA | ||
Pinanzahl 90 | ||
Betriebstemperatur min. -40°C | ||
Maximale Betriebstemperatur 85°C | ||
Serie IS42S32400J | ||
Normen/Zulassungen RoHS | ||
Automobilstandard Nein | ||
Maximale Versorgungsspannung 3.6V | ||
Minimale Versorgungsspannung 3V | ||
Versorgungsstrom 120mA | ||
Der ISSI 128 Mb SDRAM ist ein Hochgeschwindigkeits-CMOS-Speicher mit dynamischem Random-Zugriff, der für den Betrieb in 3,3-V-VDD- und 3,3-V-VDDQ-Speichersystemen mit 134.217.728 Bit ausgelegt ist. Intern konfiguriert als Quad-Bank-DRAM mit einer synchronen Schnittstelle. Jede 33. 554. 432-Bit-Banke ist in 4. 096 Zeilen mit 256 Spalten mit 32 Bit organisiert. Alle Signale werden an der positiven Kante des Taktsignals, CLK, aufgezeichnet. Alle Ein- und Ausgänge sind LVTTL-kompatibel. Der 128-MB-SDRAM verfügt über die Fähigkeit, synchron Daten mit hoher Datenrate mit automatischer Spaltenadressenerzeugung, die Fähigkeit, zwischen internen Bänken zu interleave, um die Nachladezeit zu verbergen, und die Fähigkeit, Spaltenadressen auf jedem Taktzyklus während des Burst-Zugriffs zufällig zu ändern.
Automatische Aktualisierung (CBR)
Selbstaktualisierung
LLVTTL-Schnittstelle
Zufällige Spaltenadresse für jeden Taktzyklus
